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AMD次期アーキテクチャCPU「Zen 6」の3D V-Cache搭載モデルは、最大288 MBのキャッシュを搭載する見込み

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AMD Zen6

Image via Techpowerup

AMDの次期アーキテクチャCPU「Zen 6」においても3D V-Cache搭載のX3Dサフィクションモデルを提供し続ける見込みですが、大幅に大きなキャッシュ容量を備える可能性があると報じられています。

AMD "Zen 6" SKUs with 3D V-Cache Could Pack Up to 288 MB of Cache | TechPowerUp

最大288 MBの3D V-Cache搭載?

XのHXL氏によれば、Zen 6アーキテクチャCPUのシングルCCD版は144MBの3D V-Cacheを搭載し、デュアルCCD構成では倍の288MBのキャッシュを備える、と述べています。これは、AMDが従来通りのCPU設計(クライアントI/Oダイと2つの独立したCCD)を維持しつつ、各CCDのキャッシュ容量を増加させる方針を示唆しています。

「Zen 6」では、AMDはCPU CCDをTSMCのN2P 2nmノードバリエーションに配置し、cIODをN3P 3nmノードで製造する計画である。さらに、キャッシュ容量の増加は、AVX512_BMM、AVX512_FP16、AVX_NE_CONVERT、AVX_IFMA、AVX_VNNI_INT8 などの高度な x86-64 命令拡張によって補完されます。これは特に注目すべき点であり、16ビットAVX-512演算がコンシューマー向けデスクトップCPUで可能となり、高速メモリプールを近接させることでさらなる性能向上が期待できます。

Intel次期CPU「Nova Lake」も模倣予定

Intelの次期CPU「Nova Lake」においても大型ラストレベルキャッシュ(bLLC)を導入予定であり、噂によればシングルコンピュートダイ搭載SKUでは144MB、デュアルコンピュートダイ搭載SKUでは288MBを提供する見込み、とされています。

Intel already employs bLLC in its "Clearwater Forest" server processors as a passive interposer, integrating local cache beneath active tiles.

Intelは既に「Clearwater Forest(サーバ向けCPU)」でbLLCをPassive interposerとして採用し、アクティブタイル下にローカルキャッシュを統合している。

AMD "Zen 6" SKUs with 3D V-Cache Could Pack Up to 288 MB of Cache | TechPowerUp

Intelもゲーミング向けCPUにおいてキャッシュ容量を大幅に増強し性能を底上げするアプローチをとるようです。この技術をクライアント向けゲーミングCPUに組み込むことで性能が大幅に向上し、AMDの次世代「Zen 6」プロセッサファミリーに対する強力な競争力を獲得する可能性があります。

www.techpowerup.com

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